FIUMICELLI, GABRIELE

	Nome completo
	
					FIUMICELLI, GABRIELE
				
	Afferenza
	
					DIPARTIMENTO DI ELETTRONICA, INFORMAZIONE E BIOINGEGNERIA
				
	Pagina personale
	
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First Study of Bubble Error Artifacts in Field-Programmable Gate Array (FPGA)-Based Tapped Delay-Line Time-to-Digital Converters with Sum-of-Ones Decoder on Xilinx 28 nm 7-Series FPGA

2025-01-01 Lusardi, Nicola; Garzetti, Fabio; Fiumicelli, Gabriele; Morabito, Mattia; Bonanno, Gabriele; Ronconi, Enrico; Costa, Andrea; Geraci, Angelo

High-Precision Digital-to-Time Converter with High Dynamic Range for 28 nm 7-Series Xilinx FPGA and SoC Devices

2024-01-01 Garzetti, Fabio; Lusardi, Nicola; Corna, Nicola; Fiumicelli, Gabriele; Cattaneo, Federico; Bonanno, Gabriele; Costa, Andrea; Ronconi, Enrico; Geraci, Angelo

Optimal Implementation of Tapped Delay Line Time-to-Digital Converters in 20 nm Xilinx UltraScale FPGAs

2024-01-01 Morabito, Mattia; Lusardi, Nicola; Garzetti, Fabio; Fiumicelli, Gabriele; Bonanno, Gabriele; Ronconi, Enrico; Costa, Andrea; Geraci, Angelo

Titolo	Data di pubblicazione	Autori
First Study of Bubble Error Artifacts in Field-Programmable Gate Array (FPGA)-Based Tapped Delay-Line Time-to-Digital Converters with Sum-of-Ones Decoder on Xilinx 28 nm 7-Series FPGA	1-gen-2025	Lusardi, NicolaGarzetti, FabioFiumicelli, GabrieleMorabito, MattiaBonanno, GabrieleRonconi, EnricoCosta, AndreaGeraci, Angelo + -
High-Precision Digital-to-Time Converter with High Dynamic Range for 28 nm 7-Series Xilinx FPGA and SoC Devices	1-gen-2024	Garzetti, FabioLusardi, NicolaCorna, NicolaFiumicelli, GabrieleCattaneo, FedericoBonanno, GabrieleCosta, AndreaRonconi, EnricoGeraci, Angelo + -
Optimal Implementation of Tapped Delay Line Time-to-Digital Converters in 20 nm Xilinx UltraScale FPGAs	1-gen-2024	Morabito, MattiaLusardi, NicolaGarzetti, FabioFiumicelli, GabrieleBonanno, GabrieleRonconi, EnricoCosta, AndreaGeraci, Angelo + -

RE.PUBLIC@POLIMI pubblicazioni di ricerca del Politecnico di Milano

FIUMICELLI, GABRIELE

First Study of Bubble Error Artifacts in Field-Programmable Gate Array (FPGA)-Based Tapped Delay-Line Time-to-Digital Converters with Sum-of-Ones Decoder on Xilinx 28 nm 7-Series FPGA

High-Precision Digital-to-Time Converter with High Dynamic Range for 28 nm 7-Series Xilinx FPGA and SoC Devices

Optimal Implementation of Tapped Delay Line Time-to-Digital Converters in 20 nm Xilinx UltraScale FPGAs